사각 패널 위에 칩을 만든다 — 반도체 패키징 기술의 변화가 SSD 시장에 미치는 영향

사각 패널 위에 칩을 만든다 — 반도체 패키징 기술의 변화가 PC·저장장치 시장에 미치는 영향

2026년 5월 29일

반도체 제조에서 '패키징'은 완성된 칩을 외부 환경과 연결하기 위해 포장하는 공정입니다. 오랫동안 이 공정은 둥근 원형 웨이퍼를 기준으로 설계되어 왔습니다. 그런데 최근 램리서치(Lam Research)를 비롯한 글로벌 반도체 장비 업체들이 이 방식에 근본적인 변화를 추진하고 있습니다.

원형 웨이퍼 대신 사각 패널을 사용하는 '패널 레벨 패키징(PLP, Panel Level Packaging)'이 그것입니다. 이 기술의 상용화가 본격적으로 논의되면서, SSD와 낸드 플래시 저장장치 시장에도 변화의 기류가 감지되고 있습니다.

원형 웨이퍼의 한계가 드러나기 시작했다

반도체는 지름 300mm짜리 둥근 실리콘 웨이퍼 위에 회로를 새겨 만듭니다. 문제는 원형이라는 형태 자체에 있습니다. 웨이퍼 가장자리 쪽은 사각형 칩과 형태가 맞지 않아 버려지는 면적이 생길 수밖에 없습니다.

원형 웨이퍼의 낭비 문제

300mm 원형 웨이퍼에서 대형 AI 칩을 생산할 경우, 하나의 웨이퍼에 최대 8개 내외의 칩만 배치할 수 있습니다.

동일한 면적의 사각 패널을 사용하면 최대 15개까지 배치가 가능하다는 연구 결과가 나와 있습니다.

생산 효율이 두 배 가까이 차이 나는 셈입니다.

AI 반도체는 칩 하나의 크기가 점점 커지고 있습니다. GPU와 HBM(고대역폭 메모리)이 하나의 패키지로 묶이는 방식이 확산되면서, 기존 원형 웨이퍼 구조로는 공간 손실이 더욱 두드러지고 있습니다.

패널 레벨 패키징(PLP)이란 무엇인가

PLP는 기존의 둥근 웨이퍼 대신 사각형 패널 위에 칩을 올려 한 번에 패키징하는 기술입니다. PCB(인쇄회로기판)와 비슷한 형태의 큰 사각 패널을 사용하기 때문에, 원형 웨이퍼에서 발생하는 가장자리 낭비 면적을 크게 줄일 수 있습니다.

구분	원형 웨이퍼 패키징	패널 레벨 패키징 (PLP)
형태	지름 300mm 원형	직사각형 패널
면적 효율	가장자리 낭비 발생	낭비 최소화
대형 칩 배치 수	8개 내외	최대 15개
생산 단가	상대적으로 높음	낮아질 가능성 높음
현재 상용화 수준	표준 공정	연구·시험 단계 (2026~)

삼성전자는 이미 FOPLP(Fan-Out Panel Level Package)라는 이름으로 관련 기술을 개발 중이며, TSMC도 최근 연구에 본격 착수했습니다. 램리서치는 이 공정에 필요한 후공정 장비 연구를 확대하고 있습니다.

이 기술이 왜 저장장치와 관련이 있는가

SSD의 핵심은 낸드 플래시 메모리 칩입니다. 이 낸드 플래시 칩도 반도체 패키징 공정을 거쳐 완성됩니다.

현재 낸드 플래시 생산업체들은 AI 데이터센터 수요 폭증에 대응하기 위해 생산 라인을 HBM 쪽으로 전환하고 있습니다. 그 여파로 일반 소비자용 SSD와 외장 저장장치에 들어가는 낸드 공급이 줄어들면서 가격이 오른 상황입니다.

PLP 기술이 낸드 플래시 생산에 적용되면, 같은 면적에서 더 많은 칩을 생산할 수 있게 됩니다. 공급량이 늘어나면 가격 압박이 완화될 가능성이 있습니다. 다만 이는 기술이 상용화된 이후의 이야기이며, 현재는 아직 연구·시험 단계입니다.

상용화까지 넘어야 할 과제들

PLP 기술이 빠르게 확산되지 못한 이유가 있습니다. 업체마다 사용하는 패널 크기가 달라 장비와 공급망이 표준화되지 않았기 때문입니다.

• 1패널 크기 표준화 문제 — 삼성, TSMC, 인텔 등 각 업체가 서로 다른 사이즈의 패널을 사용하고 있어 장비 호환성이 떨어집니다.
• 2수율(양품 비율) 확보 — 패널이 크면 한 번의 공정 실패가 더 큰 손실로 이어질 수 있어, 수율을 안정적으로 끌어올리는 작업이 필요합니다.
• 3설비 투자 비용 — 기존 원형 웨이퍼 라인을 패널 방식으로 전환하려면 대규모 장비 교체가 필요합니다.
• 4생태계 구축 — 세계반도체장비재료협회(SEMI)를 중심으로 패널 크기 표준안을 마련하는 작업이 2026년 현재 진행 중입니다.

업계에서는 CPO(Co-Packaged Optics) 기술과 함께 PLP가 2026년을 기점으로 상용화 전환점에 들어설 것으로 보고 있습니다. 다만 일반 소비자용 저장장치에 실질적인 영향이 나타나기까지는 수년이 더 걸릴 수 있습니다.

저장장치 시장에 미치는 영향, 현실적으로 보면

PLP 기술이 낸드 플래시 생산에 완전히 적용되었을 때 예상되는 변화는 크게 두 가지입니다.

• 생산 효율 증가 — 동일한 원자재로 더 많은 낸드 칩을 만들 수 있어 공급이 늘어날 수 있습니다.
• 가격 구조 변화 — 공급 확대가 이루어지면 SSD와 외장 저장장치의 가격 인하 압력이 생깁니다.

그러나 현 시점에서 소비자에게 체감되는 변화는 아직 없습니다. AI 데이터센터의 저장장치 수요가 워낙 빠르게 늘고 있어, 생산 효율이 오르더라도 그 물량을 AI 인프라 쪽이 먼저 흡수할 가능성이 큽니다.

현재 저장장치 시장 상황 요약

AI 데이터센터 수요로 HDD 납기가 1년 이상 지연되고, SSD 가격은 2배 이상 오른 상태입니다.

PLP 기술이 낸드 생산에 적용되더라도, 공급이 소비자 시장까지 내려오는 데 시간이 걸립니다.

저장장치가 필요하다면 현 시점에서는 구매를 미루기보다 빠르게 결정하는 것이 유리합니다.

데이터 복구 관점에서 본 패키징 기술 변화

반도체 패키징 방식이 달라지면 저장장치 고장 패턴도 달라질 수 있습니다.

현재 SSD에 사용되는 낸드 플래시 칩은 TSOP, BGA, TLGA 등 분리형 패키징이 주를 이룹니다. PLP 방식이 본격화되면 칩과 기판의 결합 구조가 달라지고, 물리적 고장 시 복구 접근 방식도 변화할 수 있습니다.

이미 USB 메모리에서는 COB(Chip On Board) 방식처럼 칩이 기판에 직접 패키징된 구조가 보편화되어 있습니다. 이 구조는 제품을 소형화하고 생산 비용을 낮추는 데 유리하지만, 고장이 발생했을 때 데이터 복구 난이도가 크게 올라가는 특성이 있습니다.

저장장치 패키징이 고도화될수록 일반적인 방법으로는 데이터에 접근하기 어려운 구조가 늘어납니다. 전문 복구 장비와 기술력이 요구되는 상황도 함께 증가하게 됩니다.

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